深圳电路板克隆DDS的便携式设备的省电设计方案

    因为M必须为整数，所以对于给定的采样速率，传统DDS只能合成2（C-1）个独特的频率。也就是说，当M=0时，输出频率为0（DC）；当M=2（C-1）-1时，输出频率只差0.5fS。所有剩余的输出频率都是fs/（2C）（DDS的频率分辨率）的增量。多数情况下，如此精密的频率分辨率是非常令人满意的。例如，AD9913拥有一个32位累加器，其频率分辨率为（250MHz）/232，或者大约0.058Hz。
    现在考虑这样一种情况：一个传统DDS具有一个32位累加器，要求利用它来合成一个恰好为采样速率的1/1000的输出频率。这意味着fO/fS=1/1000，将它代入方程式1的左边并求解M可得：M=232/1000，或M=4294967.296。该M显然不是整数，但传统DDS要求M必须是整数值，因此使用它的最接近整数值，本例为4294967。问题在于，使用这个调谐字不能精确地合成0.001fS的频率，而是合成大约0.000999999931fS的频率。在某些应用中，例如网络时钟应用，这一细微的偏差是不可接受的。
    传统DDS中的C位相位累加器导致模数（N）是固定的，即N=2C。可编程模数DDS架构对相位累加器进行了巧妙的改造，使得模数可以是满足条件1≤N≤2C的任意整数。也就是说，N值可以由用户设定。对于可编程模数DDS架构，当N=1或N=2时，合成的频率为0Hz，因此可用的最小模数（用于产生DC以外的输出）为N=3。像传统DDS一样，可编程模数DDS也要求方程式1中的M为整数。然而，由于N是可编程的，因此DDS输出频率方程式变为
    fO/fS =M/N （2）
    方程式2乍看之下平淡无奇，实则颇具意义。考虑选择特定模数N=2C的情况，此时可以合成的频率集与传统DDS相同。然而，可编程模数DDS不仅包括传统DDS的整个频率集，而且包括许许多多的其他频率。这是因为，每个特定的N值（从3到2C）都对应与M（1≤M<0.5N-1）相关的所有频率。对于任何给定的采样速率，它所代表的可能输出频率集远远大于传统DDS。
    可编程模数架构的优势在于，几乎所有的有理数频率比都可以合成。例如，现在令M=1、N=1000，就可以精确合成fO=fS/1000的频率。事实上，不仅可以合成fO=fS/1000，还能合成fS/1000的各次谐波（最高499次，即最高谐波次数为0.5N-1）。
    DDS解决方案的功耗一直比较高，例如AD9850，它是20世纪90年代中期推出的首批DDS产品之一，集成数模转换器（DAC），在50MHz输出带宽时的功耗为380mW;而AD9913采用了创新技术，其带宽功耗比相对于AD9850提高了20倍。
    AD9913带给便携式和/或仪器仪表应用的好处主要有三方面：50mW的低功耗使得手持式和其他便携式应用也能受惠于DDS技术；可编程模数架构对于网络时钟和仪器仪表应用是一项有吸引力的特性，它支持合成同一速率的任意有理分数（两个整数的比）的频率。传统的DDS只能合成同一速率的分母为2的幂的有理分数频率，例如1/4和5/16，而AD9913则不受“2的幂”限制，它能产生同一速率的任意有理分数频率，如1/10、3/7或286/11487等，只要它们处于AD9913的编程范围内；最后，AD9913像ADI公司的一些早期DDS产品一样，能够极其灵活地产生多种波形。
    AD9913采用了多项创新省电技术，从而实现低功耗特性。第一项创新涉及到DDS的相位幅度转换部分，该部分根据一个正弦和/或余弦函数将相位累加器产生的瞬时相位值转换为幅度值。传统上，此任务由一个只读存储器（ROM）查找表来执行。然而，随着DDS技术的速度不断提高，结构日益复杂，ROM方法的功耗负担已变得不可接受，这就需要使用一个专有角度-旋转（angle-rotation）算法，依靠计算引擎来执行正弦和/或余弦转换。pcb抄板角度-旋转算法方法可以追溯到AD9850，相比于ROM查找表方法，其功耗大大降低。如果不采用角度-旋转算法，许多早期DDS产品将需要特殊的散热封装来适应更高的功耗。此外，散热考虑还可能会使我们不得不减去现有DDS产品上的许多有用功能，例如，对DDS输出信号的数字相位和/或频率调制、利用数字滤波降低sin（x）/x损耗、针对多通道应用使用多个DDS内核。
    第二项重大省电突破可以归功于ADI公司已获专利的相位交错DDS架构（美国专利第6587863号）。相位-旋转算法实现的节能降耗使得我们可以考虑在同一芯片上运行多个DDS内核。我们发现，以较低采样速率运行多个DDS内核的功耗小于以极高采样速率运行一个DDS内核的功耗，这是一项非常有意义的突破，因为要充分利用新型高分辨率（14位或更高）、高采样速率（1GHz或更高）数模转换器（DAC）内核，必须创新DDS技术。交错DDS架构使得设计工程师能够集成多个已经降低功耗的DDS内核，并且以低于高频DAC内核的采样速率运行这些内核。这种创新架构连同180nm CMOS制造工艺的采用，导致DDS输出带宽显着提高，而功耗只比上一代低频DDS产品略有增加。
    然而，对于手持式和便携式应用，即使有了上述创新，功耗仍然显得过大。电路板克隆为了解决这一问题，还需要一项创新。为此，我们对角度-旋转算法进行改进，推出一种新的专有算法，以便进一步降低DDS内核的功耗。新算法与注重低功耗操作的设计原则相结合，使得设计工程师能够实现期望的低功耗设计目标。新的设计原则包括：关闭特定工作模式不需要的所有多余内部时钟，以及在不会降低频谱性能或不当地限制带宽的前提下，削减每个电路模块的功耗。
    这些创新的成果就是AD9913，其采样速率最高可达250MHz，而功耗仅有50mW。在250MHz的采样速率下，可用带宽约为100MHz。AD9913的这种输出频率能力和低功耗特性使它特别适合各种无线电控制单元，以及用于条形码和射频识别（RFID）标签的无线扫描器。然而，对于要求100MHz以上带宽的应用，必须使用一个辅助PLL进行上变频。其他能够受益于低功耗DDS技术的手持式/便携式应用包括：软件无线电（SDR）、远程或便携式有线电视测试设备、医疗血糖仪、无线火灾报警，以及频谱分析仪和波形发生器等电子测量设备。